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发表于 2004-2-7 20:52
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HyperTranport2.0规格下周公布
根据clubic报道,HyperTransport联盟将在下周1公布HyperTransport2.0版本的技术规格。
HyperTransport联盟由IBM、AMD、nVIDIA和其他业界企业组成。2.0版本的HyperTransport总线速度将比目前1.0版本的HyperTransport总线速提升75%。2.0版本的HyperTransport总线也包含对PCI Express技术的支持和优化。
2.0版本HyperTransport总线将让处理器和系统其他设备之间的数据传输带宽提升到20GB/s,比目前的12.8GB/s提升64%。AMD目前在Athlon 64处理器上使用1.0版本的HyperTransport总线,AMD计划在下一代Athlon 64处理器和相应的芯片组上使用2.0版本的HyperTransport总线。
HyperTransport 技术
HyperTransport 技术是一种创新的技术,提供积体电路可升级、进阶高速、高效能及点对点连结的功能。它具有 4、8、16 及 32 位元频宽的高速序列连结功能,并提供每秒 12.8 GB 的频宽,可支援多种 GHz+ 64 位元处理器及新兴的 I/O 技术,例如:Intel 的 InfiniBand 及 10 Gigabit 乙太网路。HyperTransport 是一种协定而非仅是一种实体的界面,它可以因应新的应用程式而升级。在 HyperTransport 协定中,资料被切割成资料区块或封包。每个资料区块最长可以到达 64 位元。
HyperTransport 技术有助于减少系统中汇排的数目,并且可提供内嵌应用程式高效能的连结。有了 HyperTransport 技术,PC (相互沟通的网路及通讯装置) 中的晶片可以增加比现有技术快 40 倍的速度。HyperTransport 是特别为小于 0.13 微米的晶片规格而设计的。
HyperTransport 的目的并不是要取代其他的 I/O 技术,而是要提供一种符合记忆体及 I/O 元件资料传输需求的高标准晶片对晶片的内部连结,它可以而容易地连结低速的传统 I/O 装置及高速的新媒界 I/O 通道。
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